function [:] cmd_data;
input [:] index;
begin
case(index)
'd0 :cmd_data={1'b1,'h000,8'h00};//set spi --
'd1 :cmd_data={1'b1,'h3df,8'h01};//set init --
'd2 :cmd_data={1'b0,'h037,8'h00};//readPartNumbereadPartNumber //ad9361——ID --
'd3 :cmd_data={1'b1,'h295,8'h14};//Power up XO path (Default) // no find --||--
'd4 :cmd_data={1'b1,'h2A6,8'h0E};//Enable Master Bias //主偏置和带隙基准 --
'd5 :cmd_data={1'b1,'h2A8,8'h0E};//Set Bandgap Trim //主偏置和带隙基准 --
'd6 :cmd_data={1'b1,'h292,8'h08};//Set DCXO Coarse Tune[5:0]
'd7 :cmd_data={1'b1,'h293,8'hB9};//Set DCXO Fine Tune [12:5]
'd8 :cmd_data={1'b1,'h294,8'h00};//Set DCXO Fine Tune [4:0]
'd9 :cmd_data={1'b1,'h2AB,8'h07};//Set RF PLL reflclk scale to REFCLK * 2
'd10 :cmd_data={1'b1,'h2AC,8'hFF};//Set RF PLL reflclk scale to REFCLK * 2
'd11 :cmd_data={1'b1,'h009,8'h17};//Enable Clocks//wait 20ms
'd12 :cmd_data={1'b1,'h045,8'h03};//Set BBPLL reflclk scale to REFCLK *2
'd13 :cmd_data={1'b1,'h046,8'h03};//Set BBPLL Loop Filter Charge Pump current
'd14 :cmd_data={1'b1,'h048,8'hE8};//Set BBPLL Loop Filter C1, R1
'd15 :cmd_data={1'b1,'h049,8'h5B};//Set BBPLL Loop Filter R2, C2, C1
'd16 :cmd_data={1'b1,'h04A,8'h35};//Set BBPLL Loop Filter C3,R2
'd17 :cmd_data={1'b1,'h04B,8'hE0};//Allow calibration to occur and set cal count to 1024 for max accuracy
'd18 :cmd_data={1'b1,'h04E,8'h10};//Set calibration clock to REFCLK/4 for more accuracy
'd19 :cmd_data={1'b1,'h043,8'h8A};//BBPLL Freq Word (Fractional[7:0])
'd20 :cmd_data={1'b1,'h042,8'h9D};//BBPLL Freq Word (Fractional[15:8])
'd21 :cmd_data={1'b1,'h041,8'h13};//BBPLL Freq Word (Fractional[23:16])
'd22 :cmd_data={1'b1,'h044,8'h18};//BBPLL Freq Word (Integer[7:0])
'd23 :cmd_data={1'b1,'h03F,8'h05};//Start BBPLL Calibration
'd24 :cmd_data={1'b1,'h03F,8'h01};//Clear BBPLL start calibration bit
'd25 :cmd_data={1'b1,'h04C,8'h86};//Increase BBPLL KV and phase margin
'd26 :cmd_data={1'b1,'h04D,8'h01};//Increase BBPLL KV and phase margin
'd27 :cmd_data={1'b1,'h04D,8'h05};//Increase BBPLL KV and phase margin
'd28 :cmd_data={1'b0,'h05E,8'h00};//Wait for BBPLL to lock when 0x05E[7]==1
'd29 :cmd_data={1'b1,'h002,8'hCC};// Setup Tx Digital Filters/ Channels
'd30 :cmd_data={1'b1,'h003,8'hDC};// Setup Rx Digital Filters/ Channels
'd31 :cmd_data={1'b1,'h004,8'h4C};// Select Rx input pin(C)/ Tx out pin (B)
'd32 :cmd_data={1'b1,'h00A,8'h9A};// Set BBPLL post divide rate
'd33 :cmd_data={1'b1,'h010,8'hCC};// PPORT Config 1
'd34 :cmd_data={1'b1,'h011,8'h00};// PPORT Config 2
'd35 :cmd_data={1'b1,'h012,8'h10};// PPORT Config 3
'd36 :cmd_data={1'b1,'h006,8'h04};// PPORT Rx Delay (adjusts Tco Dataclk->Data)
'd37 :cmd_data={1'b1,'h007,8'h70};// PPORT TX Delay (adjusts setup/hold FBCLK->Data)
'd38 :cmd_data={1'b1,'h03C,8'h22};// LVDS Settings
'd39 :cmd_data={1'b1,'h03D,8'h00};// LVDS polarity invert
'd40 :cmd_data={1'b1,'h03E,8'h00};// LVDS polarity invert
'd41 :cmd_data={1'b1,'h018,8'h80};// AuxDAC1 Word[9:2]
'd42 :cmd_data={1'b1,'h019,8'h80};// AuxDAC2 Word[9:2]
'd43 :cmd_data={1'b1,'h01A,8'h00};// AuxDAC1 Config and Word[1:0]
'd44 :cmd_data={1'b1,'h01B,8'h00};// AuxDAC2 Config and Word[1:0]
'd45 :cmd_data={1'b1,'h023,8'h3F};// AuxDAC Manaul/Auto Control
'd46 :cmd_data={1'b1,'h026,8'h80};// AuxDAC Manual Select Bit/GPO Manual Select
'd47 :cmd_data={1'b1,'h030,8'h00};// AuxDAC1 Rx Delay
'd48 :cmd_data={1'b1,'h031,8'h00};// AuxDAC1 Tx Delay
'd49 :cmd_data={1'b1,'h032,8'h00};// AuxDAC2 Rx Delay
'd50 :cmd_data={1'b1,'h033,8'h00};// AuxDAC2 Tx Delay
'd51 :cmd_data={1'b1,'h00B,8'hCE};// Temp Sensor Setup (Offset)
'd52 :cmd_data={1'b1,'h00C,8'h00};// Temp Sensor Setup (Temp Window)
'd53 :cmd_data={1'b1,'h00D,8'h05};// Temp Sensor Setup (Periodic Measure)
'd54 :cmd_data={1'b1,'h00F,8'h00};// Temp Sensor Setup (Decimation)
'd55 :cmd_data={1'b1,'h01C,8'h18};// AuxADC Setup (Clock Div)
'd56 :cmd_data={1'b1,'h01D,8'h01};// AuxADC Setup (Decimation/Enable)
'd57 :cmd_data={1'b1,'h035,8'h00};// Ctrl Out index
'd58 :cmd_data={1'b1,'h036,8'hFF};// Ctrl Out [7:0] output enable
'd59 :cmd_data={1'b1,'h03A,8'h19};// Set number of REFCLK cycles for 1us delay timer
'd60 :cmd_data={1'b1,'h020,8'h00};// GPO Auto Enable Setup in RX and TX
'd61 :cmd_data={1'b1,'h027,8'h03};// GPO Manual and GPO auto value in ALERT
'd62 :cmd_data={1'b1,'h028,8'h00};// GPO_0 RX Delay
'd63 :cmd_data={1'b1,'h029,8'h00};// GPO_1 RX Delay
'd64 :cmd_data={1'b1,'h02A,8'h00};// GPO_2 RX Delay
'd65 :cmd_data={1'b1,'h02B,8'h00};// GPO_3 RX Delay
'd66 :cmd_data={1'b1,'h02C,8'h00};// GPO_0 TX Delay
'd67 :cmd_data={1'b1,'h02D,8'h00};// GPO_1 TX Delay
'd68 :cmd_data={1'b1,'h02E,8'h00};// GPO_2 TX Delay
'd69 :cmd_data={1'b1,'h02F,8'h00};// GPO_3 TX Delay
'd70 :cmd_data={1'b1,'h261,8'h00};// Set Rx LO Power mode
'd71 :cmd_data={1'b1,'h2A1,8'h00};// Set Tx LO Power mode
'd72 :cmd_data={1'b1,'h248,8'h0B};// Enable Rx VCO LDO
'd73 :cmd_data={1'b1,'h288,8'h0B};// Enable Tx VCO LDO
'd74 :cmd_data={1'b1,'h246,8'h02};// Set VCO Power down TCF bits
'd75 :cmd_data={1'b1,'h286,8'h02};// Set VCO Power down TCF bits
'd76 :cmd_data={1'b1,'h249,8'h8E};// Set VCO cal length
'd77 :cmd_data={1'b1,'h289,8'h8E};// Set VCO cal length
'd78 :cmd_data={1'b1,'h23B,8'h80};// Enable Rx VCO cal
'd79 :cmd_data={1'b1,'h27B,8'h80};// Enable Tx VCO cal
'd80 :cmd_data={1'b1,'h243,8'h0D};// Set Rx prescaler bias
'd81 :cmd_data={1'b1,'h283,8'h0D};// Set Tx prescaler bias
'd82 :cmd_data={1'b1,'h23D,8'h00};// Clear Half VCO cal clock setting
'd83 :cmd_data={1'b1,'h27D,8'h00};// Clear Half VCO cal clock setting
'd84 :cmd_data={1'b1,'h015,8'h04};// Set Dual Synth mode bit
'd85 :cmd_data={1'b1,'h014,8'h0D};// Set Force ALERT State bit
'd86 :cmd_data={1'b1,'h013,8'h01};// Set ENSM FDD mode,// wait 1 ms
'd87 :cmd_data={1'b1,'h23D,8'h04};// Start RX CP cal
'd88 :cmd_data={1'b0,'h244,8'h00};// Wait for CP cal to complete when 0x244[7]==1
'd89 :cmd_data={1'b1,'h27D,8'h04};// Start TX CP cal
'd90 :cmd_data={1'b0,'h284,8'h00};// Wait for CP cal to complete when 0x284[7]==1
'd91 :cmd_data={1'b1,'h23A,8'h4A};// Set VCO Output level[3:0]
'd92 :cmd_data={1'b1,'h239,8'hC0};// Set Init ALC Value[3:0] and VCO Varactor[3:0]
'd93 :cmd_data={1'b1,'h242,8'h0D};// Set VCO Bias Tcf[1:0] and VCO Bias Ref[2:0]
'd94 :cmd_data={1'b1,'h238,8'h70};// Set VCO Cal Offset[3:0]
'd95 :cmd_data={1'b1,'h245,8'h00};// Set VCO Cal Ref Tcf[2:0]
'd96 :cmd_data={1'b1,'h251,8'h09};// Set VCO Varactor Reference[3:0]
'd97 :cmd_data={1'b1,'h250,8'h70};// Set VCO Varactor Ref Tcf[2:0] and VCO Varactor Offset[3:0]
'd98 :cmd_data={1'b1,'h23B,8'h93};// Set Synth Loop Filter charge pump current (Icp)
'd99 :cmd_data={1'b1,'h23E,8'hF4};// Set Synth Loop Filter C2 and C1
'd100 :cmd_data={1'b1,'h23F,8'hDF};// Set Synth Loop Filter R1 and C3
'd101 :cmd_data={1'b1,'h240,8'h0A};// Set Synth Loop Filter R3
'd102 :cmd_data={1'b1,'h27A,8'h4A};// Set VCO Output level[3:0]
'd103 :cmd_data={1'b1,'h279,8'hC0};// Set Init ALC Value[3:0] and VCO Varactor[3:0]
'd104 :cmd_data={1'b1,'h282,8'h0D};// Set VCO Bias Tcf[1:0] and VCO Bias Ref[2:0]
'd105 :cmd_data={1'b1,'h278,8'h70};// Set VCO Cal Offset[3:0]
'd106 :cmd_data={1'b1,'h285,8'h00};// Set VCO Cal Ref Tcf[2:0]
'd107 :cmd_data={1'b1,'h291,8'h09};// Set VCO Varactor Reference[3:0]
'd108 :cmd_data={1'b1,'h290,8'h70};// Set VCO Varactor Ref Tcf[2:0] and VCO Varactor Offset[3:0]
'd109 :cmd_data={1'b1,'h27B,8'h93};// Set Synth Loop Filter charge pump current (Icp)
'd110 :cmd_data={1'b1,'h27E,8'hF4};// Set Synth Loop Filter C2 and C1
'd111 :cmd_data={1'b1,'h27F,8'hDF};// Set Synth Loop Filter R1 and C3
'd112 :cmd_data={1'b1,'h280,8'h0A};// Set Synth Loop Filter R3
'd113 :cmd_data={1'b1,'h233,8'h72};// Write Rx Synth Fractional Freq Word[7:0]
'd114 :cmd_data={1'b1,'h234,8'h62};// Write Rx Synth Fractional Freq Word[15:8]
'd115 :cmd_data={1'b1,'h235,8'h27};// Write Rx Synth Fractional Freq Word[22:16]
'd116 :cmd_data={1'b1,'h232,8'h00};// Write Rx Synth Integer Freq Word[10:8]
'd117 :cmd_data={1'b1,'h231,8'hBA};// Write Rx Synth Integer Freq Word[7:0]
'd118 :cmd_data={1'b1,'h005,8'h11};// Set LO divider setting
'd119 :cmd_data={1'b1,'h273,8'h72};// Write Tx Synth Fractional Freq Word[7:0]
'd120 :cmd_data={1'b1,'h274,8'h62};// Write Tx Synth Fractional Freq Word[15:8]
'd121 :cmd_data={1'b1,'h275,8'h27};// Write Tx Synth Fractional Freq Word[22:16]
'd122 :cmd_data={1'b1,'h272,8'h00};// Write Tx Synth Integer Freq Word[10:8]
'd123 :cmd_data={1'b1,'h271,8'hBA};// Write Tx Synth Integer Freq Word[7:0] (starts VCO cal)
'd124 :cmd_data={1'b1,'h005,8'h11};// Set LO divider setting
'd125 :cmd_data={1'b0,'h247,8'h00};// Check RX RF PLL lock status (0x247[1]==1 is locked)
'd126 :cmd_data={1'b0,'h287,8'h00};// Check TX RF PLL lock status (0x287[1]==1 is locked)
'd127 :cmd_data={1'b1,'h13F,8'h02};// Start Clock
'd128 :cmd_data={1'b1,'h138,8'h0F};// Addr Table Index
'd129 :cmd_data={1'b1,'h139,8'h78};// Gain
'd130 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd131 :cmd_data={1'b1,'h13B,8'h00};// GM
'd132 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd133 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd134 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd135 :cmd_data={1'b1,'h138,8'h0E};// Addr Table Index
'd136 :cmd_data={1'b1,'h139,8'h74};// Gain
'd137 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd138 :cmd_data={1'b1,'h13B,8'h0D};// GM
'd139 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd140 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd141 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd142 :cmd_data={1'b1,'h138,8'h0D};// Addr Table Index
'd143 :cmd_data={1'b1,'h139,8'h70};// Gain
'd144 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd145 :cmd_data={1'b1,'h13B,8'h15};// GM
'd146 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd147 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd148 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd149 :cmd_data={1'b1,'h138,8'h0C};// Addr Table Index
'd150 :cmd_data={1'b1,'h139,8'h6C};// Gain
'd151 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd152 :cmd_data={1'b1,'h13B,8'h1B};// GM
'd153 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd154 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd155 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd156 :cmd_data={1'b1,'h138,8'h0B};// Addr Table Index
'd157 :cmd_data={1'b1,'h139,8'h68};// Gain
'd158 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd159 :cmd_data={1'b1,'h13B,8'h21};// GM
'd160 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd161 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd162 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd163 :cmd_data={1'b1,'h138,8'h0A};// Addr Table Index
'd164 :cmd_data={1'b1,'h139,8'h64};// Gain
'd165 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd166 :cmd_data={1'b1,'h13B,8'h25};// GM
'd167 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd168 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd169 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd170 :cmd_data={1'b1,'h138,8'h09};// Addr Table Index
'd171 :cmd_data={1'b1,'h139,8'h60};// Gain
'd172 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd173 :cmd_data={1'b1,'h13B,8'h29};// GM
'd174 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd175 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd176 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd177 :cmd_data={1'b1,'h138,8'h08};// Addr Table Index
'd178 :cmd_data={1'b1,'h139,8'h5C};// Gain
'd179 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd180 :cmd_data={1'b1,'h13B,8'h2C};// GM
'd181 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd182 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd183 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd184 :cmd_data={1'b1,'h138,8'h07};// Addr Table Index
'd185 :cmd_data={1'b1,'h139,8'h58};// Gain
'd186 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd187 :cmd_data={1'b1,'h13B,8'h2F};// GM
'd188 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd189 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd190 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd191 :cmd_data={1'b1,'h138,8'h06};// Addr Table Index
'd192 :cmd_data={1'b1,'h139,8'h54};// Gain
'd193 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd194 :cmd_data={1'b1,'h13B,8'h31};// GM
'd195 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd196 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd197 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd198 :cmd_data={1'b1,'h138,8'h05};// Addr Table Index
'd199 :cmd_data={1'b1,'h139,8'h50};// Gain
'd200 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd201 :cmd_data={1'b1,'h13B,8'h33};// GM
'd202 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd203 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd204 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd205 :cmd_data={1'b1,'h138,8'h04};// Addr Table Index
'd206 :cmd_data={1'b1,'h139,8'h4C};// Gain
'd207 :cmd_data={1'b1,'h13A,8'h00};// Bias
'd208 :cmd_data={1'b1,'h13B,8'h34};// GM
'd209 :cmd_data={1'b1,'h13F,8'h06};// Write Words
'd210 :cmd_data={1'b1,'h13C,8'h00};// Delay for 3 ADCCLK/16 clock cycles (Dummy Write)
'd211 :cmd_data={1'b1,'h13C,8'h00};// Delay ~1us (Dummy Write)
'd212 :cmd_data={1'b1,'h138,8'h03};// Addr Table Index
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'd214 :cmd_data={1'b1,'h13A,8'h00};// Bias
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'd219 :cmd_data={1'b1,'h138,8'h02};// Addr Table Index
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'd221 :cmd_data={1'b1,'h13A,8'h00};// Bias
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'd885 :cmd_data={1'b1,'h137,8'h00};// Stop Gain Table Clock
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'd890 :cmd_data={1'b1,'h0FE,8'h44};// Decr Step Size, Peak Overload Time
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'd903 :cmd_data={1'b1,'h114,8'h30};// Low Power Threshold
'd904 :cmd_data={1'b1,'h11A,8'h27};// Initial LMT Gain Limit
'd905 :cmd_data={1'b1,'h081,8'h00};// Tx Symbol Gain Control
'd906 :cmd_data={1'b1,'h1FB,8'h0A};// RX Freq Corner (MHz)
'd907 :cmd_data={1'b1,'h1FC,8'h00};// RX Freq Corner (Khz)
'd908 :cmd_data={1'b1,'h1F8,8'h0B};// Rx BBF Tune Divider[7:0]
'd909 :cmd_data={1'b1,'h1F9,8'h1E};// RX BBF Tune Divider[8]
'd910 :cmd_data={1'b1,'h1D5,8'h3F};// Set Rx Mix LO CM
'd911 :cmd_data={1'b1,'h1C0,8'h03};// Set GM common mode
'd912 :cmd_data={1'b1,'h1E2,8'h02};// Enable Rx1 Filter Tuner
'd913 :cmd_data={1'b1,'h1E3,8'h02};// Enable Rx2 Filter Tuner
'd914 :cmd_data={1'b1,'h016,8'h80};// Start RX Filter Tune
'd915 :cmd_data={1'b0,'h016,8'h00};//Wait for RX filter to tune when 0x016[7]==0
'd916 :cmd_data={1'b1,'h1E2,8'h03};// Disable Rx Filter Tuner (Rx1)
'd917 :cmd_data={1'b1,'h1E3,8'h03};// Disable Rx Filter Tuner (Rx2)
'd918 :cmd_data={1'b1,'h0D6,8'h09};// TX BBF Tune Divier[7:0]
'd919 :cmd_data={1'b1,'h0D7,8'h1E};// TX BBF Tune Divider[8]
'd920 :cmd_data={1'b1,'h0CA,8'h22};// Enable Tx Filter Tuner
'd921 :cmd_data={1'b1,'h016,8'h40};// Start Tx Filter Tune
'd922 :cmd_data={1'b0,'h016,8'h00};//Wait for RX filter to tune when 0x016[6]==0
'd923 :cmd_data={1'b1,'h0CA,8'h26};// Disable Tx Filter Tuner (Both Channels)
'd924 :cmd_data={1'b0,'h1EB,8'h00};// Read RXBBF C3(MSB)
'd925 :cmd_data={1'b0,'h1EC,8'h00};// Read RXBBF C3(LSB)
'd926 :cmd_data={1'b0,'h1E6,8'h00};// Read RXBBF R2346
'd927 :cmd_data={1'b1,'h1DB,8'h20};// Set TIA selcc[2:0]
'd928 :cmd_data={1'b1,'h1DD,8'h00};// Set RX TIA1 C MSB[6:0]
'd929 :cmd_data={1'b1,'h1DF,8'h00};// Set RX TIA2 C MSB[6:0]
'd930 :cmd_data={1'b1,'h1DC,8'h63};// Set RX TIA1 C LSB[5:0]
'd931 :cmd_data={1'b1,'h1DE,8'h63};// Set RX TIA2 C LSB[5:0]
'd932 :cmd_data={1'b1,'h0D2,8'h14};// TX Secondary Filter PDF Cap cal[5:0]
'd933 :cmd_data={1'b1,'h0D1,8'h0C};// TX Secondary Filter PDF Res cal[3:0]
'd934 :cmd_data={1'b1,'h0D0,8'h56};// Pdampbias
'd935 :cmd_data={1'b0,'h1EB,8'h00};// Read RxBBF C3 MSB after calibration
'd936 :cmd_data={1'b0,'h1EC,8'h00};// Read RxBBF C3 LSB after calibration
'd937 :cmd_data={1'b0,'h1E6,8'h00};// Read RxBBF R3 after calibration
'd938 :cmd_data={1'b1,'h200,8'h00};//************************************************************
'd939 :cmd_data={1'b1,'h201,8'h00};// ADC Setup: Tune ADC Performance based on RX analog filter tune
'd940 :cmd_data={1'b1,'h202,8'h00};// corner. Real Bandwidth: 8.606890 MHz, ADC Clock Frequency:
'd941 :cmd_data={1'b1,'h203,8'h24};// 245.760000 MHz. The values in registers 0x200 - 0x227 need to be
'd942 :cmd_data={1'b1,'h204,8'h24};// calculated using the equations in the Calibration Guide.
'd943 :cmd_data={1'b1,'h205,8'h00};//************************************************************
'd944 :cmd_data={1'b1,'h206,8'h00};
'd945 :cmd_data={1'b1,'h207,8'h7B};
'd946 :cmd_data={1'b1,'h208,8'h40};
'd947 :cmd_data={1'b1,'h209,8'h3B};
'd948 :cmd_data={1'b1,'h20A,8'h4A};
'd949 :cmd_data={1'b1,'h20B,8'h28};
'd950 :cmd_data={1'b1,'h20C,8'h4D};
'd951 :cmd_data={1'b1,'h20D,8'h26};
'd952 :cmd_data={1'b1,'h20E,8'h00};
'd953 :cmd_data={1'b1,'h20F,8'h7E};
'd954 :cmd_data={1'b1,'h210,8'h7D};
'd955 :cmd_data={1'b1,'h211,8'h7E};
'd956 :cmd_data={1'b1,'h212,8'h48};
'd957 :cmd_data={1'b1,'h213,8'h47};
'd958 :cmd_data={1'b1,'h214,8'h48};
'd959 :cmd_data={1'b1,'h215,8'h4B};
'd960 :cmd_data={1'b1,'h216,8'h4A};
'd961 :cmd_data={1'b1,'h217,8'h4B};
'd962 :cmd_data={1'b1,'h218,8'h2E};
'd963 :cmd_data={1'b1,'h219,8'h9F};
'd964 :cmd_data={1'b1,'h21A,8'h22};
'd965 :cmd_data={1'b1,'h21B,8'h16};
'd966 :cmd_data={1'b1,'h21C,8'h9F};
'd967 :cmd_data={1'b1,'h21D,8'h22};
'd968 :cmd_data={1'b1,'h21E,8'h16};
'd969 :cmd_data={1'b1,'h21F,8'h9F};
'd970 :cmd_data={1'b1,'h220,8'h22};
'd971 :cmd_data={1'b1,'h221,8'h2C};
'd972 :cmd_data={1'b1,'h222,8'h2D};
'd973 :cmd_data={1'b1,'h223,8'h40};
'd974 :cmd_data={1'b1,'h224,8'h40};
'd975 :cmd_data={1'b1,'h225,8'h2C};
'd976 :cmd_data={1'b1,'h226,8'h00};
'd977 :cmd_data={1'b1,'h227,8'h00};
'd978 :cmd_data={1'b0,'h0A3,8'h00};// Masked Read: Read lower 6 bits, overwrite [7:6] below
'd979 :cmd_data={1'b1,'h0A0,8'h3A};// Set TxQuadcal NCO frequency
'd980 :cmd_data={1'b1,'h0A3,8'h40};// Set TxQuadcal NCO frequency (Only update bits [7:6])
'd981 :cmd_data={1'b1,'h0A1,8'h7B};// Set TxQuadcal M[1:0]
'd982 :cmd_data={1'b1,'h0A9,8'hFF};// Set Tx Quad Cal Count
'd983 :cmd_data={1'b1,'h0A2,8'h7F};// Set Tx Quad Cal Kexp
'd984 :cmd_data={1'b1,'h0A5,8'h01};// Set Tx Quad Cal Magnitude Threshhold
'd985 :cmd_data={1'b1,'h0A6,8'h01};// Set Tx Quad Cal Magnitude Threshhold
'd986 :cmd_data={1'b1,'h0AA,8'h22};// Set Tx Quad Cal Gain Table index
'd987 :cmd_data={1'b1,'h0A4,8'hF0};// Set Tx Quad Cal Setting Count
'd988 :cmd_data={1'b1,'h0AE,8'h00};// Set Tx Quad Cal LPF Gain index incase Split table mode used
'd989 :cmd_data={1'b1,'h193,8'h3F};// BBDC Cal setting
'd990 :cmd_data={1'b1,'h190,8'h0F};// Set BBDC tracking shift M value, only applies when BB DC tracking enabled
'd991 :cmd_data={1'b1,'h194,8'h01};// BBDC Cal setting
'd992 :cmd_data={1'b1,'h016,8'h01};// Start BBDC offset cal
'd993 :cmd_data={1'b0,'h016,8'h00};// BBDC Max Cal Time: 13151.042 us. Cal done when 0x016[0]==0
'd994 :cmd_data={1'b1,'h185,8'h20};// Set RF DC offset Wait Count
'd995 :cmd_data={1'b1,'h186,8'h32};// Set RF DC Offset Count[7:0]
'd996 :cmd_data={1'b1,'h187,8'h24};// Settings for RF DC cal
'd997 :cmd_data={1'b1,'h18B,8'h83};// Settings for RF DC cal
'd998 :cmd_data={1'b1,'h188,8'h05};// Settings for RF DC cal
'd999 :cmd_data={1'b1,'h189,8'h30};// Settings for RF DC cal
'd1000:cmd_data={1'b1,'h016,8'h02};// RFDC Max Cal Time: 59923.828 us
'd1001:cmd_data={1'b0,'h016,8'h00};// Wait for cal to complete (Done when 0x016[1]==0)
'd1002:cmd_data={1'b1,'h016,8'h10};// TXQuad Max Cal Time: 6150.000 us
'd1003:cmd_data={1'b0,'h016,8'h00};// Wait for cal to complete (Done when 0x016[4]==0)
'd1004:cmd_data={1'b1,'h168,8'h03};// Set RX Quadcal Tone Level
'd1005:cmd_data={1'b1,'h16E,8'h25};// Set Rx Gain index to use during RX Quadcal
'd1006:cmd_data={1'b1,'h16A,8'h75};// Set Kexp Phase
'd1007:cmd_data={1'b1,'h16B,8'h15};// Set Kexp Amplitude
'd1008:cmd_data={1'b1,'h169,8'hCF};
'd1009:cmd_data={1'b1,'h18B,8'hAD};
'd1010:cmd_data={1'b1,'h012,8'h10};// Cals done, Set PPORT Config
'd1011:cmd_data={1'b1,'h013,8'h01};// Set ENSM FDD/TDD bit
'd1012:cmd_data={1'b1,'h015,8'h04};// Set Dual Synth Mode, FDD External Control bits properly
'd1013:cmd_data={1'b1,'h073,8'h50};//**************************************************
'd1014:cmd_data={1'b1,'h074,8'h00};// Set Tx Attenuation: Tx1: 10.00 dB, Tx2: 10.00 dB
'd1015:cmd_data={1'b1,'h075,8'h10};//**************************************************
'd1016:cmd_data={1'b1,'h076,8'h00};
'd1017:cmd_data={1'b1,'h150,8'h69};// RSSI Measurement Duration 0, 1
'd1018:cmd_data={1'b1,'h151,8'h88};// RSSI Measurement Duration 2, 3
'd1019:cmd_data={1'b1,'h152,8'hFF};// RSSI Weighted Multiplier 0
'd1020:cmd_data={1'b1,'h153,8'h61};// RSSI Weighted Multiplier 1
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'd1022:cmd_data={1'b1,'h155,8'hFF};// RSSI Weighted Multiplier 3
'd1023:cmd_data={1'b1,'h156,8'h01};// RSSI Delay
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'd1025:cmd_data={1'b1,'h158,8'h09};// RSSI Mode Select
'd1026:cmd_data={1'b1,'h15C,8'h62};// Power Measurement Duration
'd1027:cmd_data={1'b1,'h002,8'hCC};// Set # transmitters enabled
'd1028:cmd_data={1'b1,'h003,8'hDC};// Set # receivers enabled
'd1029:cmd_data={1'b1,'h014,8'h68};// Set Force rx and tx State bit
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end
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