一、实验目的及要求
- 熟悉Quartus II 的 VHDL 文本设计简单时序电路的方法；
掌握时序电路的描述方法、波形仿真和测试，特别是时钟信号的特性。
二、实验原理
运用Quartus II 集成环境下的VHDL文本设计方法设计简单时序电路——D触发器，依据D触发器的工作特性，进行波形仿真和分析、引脚分配并下载到实验设备上进行功能测试。
三、实验内容和步骤
实验步骤和方法参考实验一，引脚分配可参考下表。
四、实验代码
掌握时序电路的描述方法、波形仿真和测试，特别是时钟信号的特性。
运用Quartus II 集成环境下的VHDL文本设计方法设计简单时序电路——D触发器，依据D触发器的工作特性，进行波形仿真和分析、引脚分配并下载到实验设备上进行功能测试。
实验步骤和方法参考实验一，引脚分配可参考下表。