本教程操作环境：windows7系统、Dell G3电脑。
VHDL是一种用普通文本形式设计数字系统的硬件描述语言，主要用于描述数字系统的结构、行为、功能和接口，可以在任何文字处理软件环境中编辑。除了含有许多具有硬件特征的语句外，其形式、描述风格及语法十分类似于计算机高级语言。
VHDL程序将一项工程设计项目（或称设计实体）分成描述外部端口信号的可视部分和描述端口信号之间逻辑关系的内部不可视部分，这种将设计项目分成内、外两个部分的概念是硬件描述语言（HDL）的基本特征。
当一个设计项目定义了外部界面（端口），在其内部设计完成后，其他的设计就可以利用外部端口直接调用这个项目。
VHDL的主要特点如下：
1）作为HDL的第一个国际标准，VHDL具有很强的可移植性。
2）具有丰富的模拟仿真语句和库函数，随时可对设计进行仿真模拟，因而能将设计中的错误消除在电路系统装配之前，在设计早期就能检查设计系统功能的可行性，有很强的预测能力。
3）VHDL有良好的可读性，接近高级语言，容易理解。
4）系统设计与硬件结构无关，方便了工艺的转换，也不会因工艺变化而使描述过时。
5）支持模块化设计，可将大规模设计项目分解成若干个小项目，还可以把已有的设计项目作为一个模块调用。
6）设计灵活，修改方便，同时也便于设计结果的交流、保存和重用，产品开发速度快，成本低。
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