问题描述
英特尔酷睿i7具有每核L1和L2缓存，以及大型共享的L3缓存。我需要知道哪种互连将多个L2连接到单个L3。我是一名学生，需要编写缓存子系统的粗略行为模型。
它是横线吗？一辆公共汽车？戒指？我遇到的参考文献都提到了缓存的结构细节，但是都没有提及存在哪种片上互连。
The Intel core i7 has per-core L1 and L2 caches, and a large shared L3 cache. I need to know what kind of an interconnect connects the multiple L2s to the single L3. I am a student, and need to write a rough behavioral model of the cache subsystem.Is it a crossbar? A single bus? a ring? The references I came across mention structural details of the caches, but none of them mention what kind of on-chip interconnect exists.
谢谢，
-neha
推荐答案
现代i7使用环。从：
您的模型将非常粗糙，但是您可以从有关L3的i7性能计数器的公共信息中收集更多信息。
Your model will be very rough, but you may be able to glean more information from public information on i7 performance counters pertaining to the L3.
这篇关于Core i7中每核L2和L3之间的互连的文章就介绍到这了，希望我们推荐的答案对大家有所帮助，也希望大家多多支持！